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HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計

深山正幸 [ほか] 著. -- 第2版. -- 共立出版, 2002. <TB00009164>
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深山正幸 [ほか] 著. -- 第2版. -- 共立出版, 2002. <TB00009164>
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No. 巻号 所蔵館 配置場所 請求記号 資料ID 禁帯出区分 状態 返却予定日 予約
0001 図書館 3F/和図書５ 549.8/F 72 05231191 　 　 0件
No. 0001
巻号
所蔵館 図書館
配置場所 3F/和図書５
請求記号 549.8/F 72
資料ID 05231191
禁帯出区分 　
状態 　
返却予定日
予約 0件
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書誌詳細

標題および責任表示 HDLによるVLSI設計 : VerilogHDLとVHDLによるCPU設計 / 深山正幸 [ほか] 著
HDL ニ ヨル VLSI セッケイ : Verilog HDL ト VHDL ニ ヨル CPU セッケイ
版事項 第2版
出版・頒布事項 東京 : 共立出版 , 2002.1
形態事項 x, 245p ; 24cm
巻号情報
ISBN 4320120272
注記 参考図書: p[241]-242
注記 その他の著者: 北川章夫, 秋田純一, 鈴木正國
学情ID BA5517252X
本文言語コード 日本語
著者標目リンク 深山, 正幸(1966-)
ミヤマ, マサユキ <>
著者標目リンク 北川, 章夫(1961-)
キタガワ, アキオ <>
著者標目リンク 秋田, 純一(1970-)
アキタ, ジュンイチ <>
著者標目リンク 鈴木, 正國(1939-)
スズキ, マサクニ <>
分類標目 電子工学 NDC8:549.7
分類標目 電子工学 NDC9:549.7
分類標目 科学技術 NDLC:ND386
件名標目等 集積回路||シュウセキカイロ
件名標目等 集積回路||シュウセキカイロ
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